The planar junction etch for high voltage and low surface fields in planar devices

二极管 蚀刻(微加工)
作者
Victor A. K. Temple,Bantval Jayant Baliga,Michael S. Adler
出处
期刊:IEEE Transactions on Electron Devices [Institute of Electrical and Electronics Engineers]
卷期号:24 (11): 1304-1310 被引量:6
标识
DOI:10.1109/t-ed.1977.19002
摘要

A modification of the moat etch type of surface contouring is described which can increase the avalanche breakdown voltage of planar p-n junctions and greatly reduce peak surface electric fields. A properly located moat etch or bevel is used to achieve what is effectively a positive bevel intersection angle between the junction and the surface. Qualitative arguments based on charge balance, exact computer solutions, and experimental results show that higher breakdown voltage and much lower surface fields can be achieved as some, but not all, of the deleterious effects of the junction curvature are eliminated. Optimum design and sensitivity to process variations are also considered.
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