An Attachable Fractional Divider Transforming an Integer-N PLL Into a Fractional-N PLL Achieving Only 0.35-psrms-Integrated-Jitter Degradation With SSC Capability

抖动 锁相环 分频器 降级(电信) 全球导航卫星系统应用 整数(计算机科学) PLL多位 电子工程 计算机科学 工程类 电信 全球定位系统 CMOS芯片 程序设计语言
作者
Atsushi Motozawa,Yasuyuki Hiraku,Yoshitaka Hirai,Naoaki Hiyama,Yusuke Imanaka,Fukashi Morishita
出处
期刊:IEEE solid-state circuits letters [Institute of Electrical and Electronics Engineers]
卷期号:6: 69-72 被引量:2
标识
DOI:10.1109/lssc.2023.3254521
摘要

PLLs are utilized in SoCs for automotive industry. In the industry, the system handles with satellite signals which are weak radio waves coming from space. Therefore, the output frequency of PLLs is carefully designed to avoid EMI. Recently, Global Navigation Satellite System (GNSS) is becoming more common and available frequency bands for clocks are getting narrow. That leads, in many products, replacement integer-N PLLs with fractional-N PLLs is needed to obtain smaller output frequency steps than reference frequency. The attachable fractional divider introduced in this talk transforms an integer-N PLL into a fractional-N PLL with only 0.35 psrms of integrated RMS jitter degradation.

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