| 标题 |
 A 28-nm 19.9-to-258.5-TOPS/W 8b Digital Computing-in-Memory Processor With Two-Cycle Macro Featuring Winograd-Domain Convolution and Macro-Level Parallel Dual-Side Sparsity |
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| 其它 |
期刊：IEEE Journal of Solid-State Circuits 作者：Hao Wu; Yong Chen; Yiyang Yuan; Jinshan Yue; Xinghua Wang; et al 出版日期：2025-01-01 |
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(2025-6-4)
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