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标题
Low power, less occupying area, and improved speed of a 4-bit router/rerouter circuit for low-density parity-check (LDPC) decoders
用于低密度奇偶校验(LDPC)解码器的4位路由器/重路由器电路的低功率、较少占用面积和改进的速度
相关领域
多路复用器 解复用器 计算机科学 加法器 电子工程 电子线路 低密度奇偶校验码 计算机硬件 CMOS芯片 多路复用 电气工程 解码方法 工程类 算法 电信
网址
https://doi.org/10.12688/f1000research.73404.1
AI链接 doi.org nih.gov nih.govdoi.org
DOI
10.12688/f1000research.73404.1 doi
其它 期刊：F1000Research
作者：C. Senthilpari; Rosalind Deena Kumari; Lini Lee
出版日期：2022-01-05
求助人
WL 在 2025-12-10 22:53:22 发布自贵州，悬赏 10 积分
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