DTCO Launches Moore’s Law Over the Feature Scaling Wall

摩尔定律 特征(语言学) 标度律 缩放比例 计算机科学 法学 政治学 数学 哲学 操作系统 几何学 语言学
作者
Victor Moroz,X-W. Lin,P. Asenov,D. Sherlekar,Munkang Choi,L. Sponton,L. S. Melvin,Jaehyun Lee,Binjie Cheng,A. Nannipieri,Jacky Huang,S. Jones
出处
期刊:International Electron Devices Meeting 被引量:1
标识
DOI:10.1109/iedm13553.2020.9372010
摘要

Instead of marching from one crisply defined technology node to the next with an uncertain timeline, industry is transitioning toward annual technology updates driven by a schedule, but with an uncertain transistor density increase. Full node updates are expected every other year, with half-node updates in between. Pitch scaling began slowing after the 10nm node and is expected to practically cease by the 1nm node. Despite that, transistor density is expected to continue increasing at a similar pace of 45% density increase per node (or 20% per year) through the 1nm node, fueled by increasingly sophisticated Design-Technology Co-Optimization (DTCO) and Electronic Design Automation (EDA) advances.
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