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作者
Jri Lee,Po-Jui Chiang,Chih-Chi Weng
出处
期刊:Symposium on VLSI Circuits
日期:2015-06-01
被引量:7
标识
DOI:10.1109/vlsic.2015.7231346
摘要
This paper presents 56Gb/s PAM4 and NRZ SerDes transceivers (TRXs), designed and fabricated in advance CMOS technology. Incorporating broadband techniques, noise suppression skills, and clock extraction circuits, this work demonstrates feasibility of 56Gb/s SerDes and compares tradeoffs between the two data format.
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