29.5 A 3nm 3.6GHz Dual-Port SRAM with Backend-RC Optimization and a Far-End Write-Assist Scheme

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标题	29.5 A 3nm 3.6GHz Dual-Port SRAM with Backend-RC Optimization and a Far-End Write-Assist Scheme
网址	http://xplorestaging.ieee.org/ielx8/10904417/10904496/109047...
DOI	10.1109/isscc49661.2025.10904736 doi
其它	期刊：2025 IEEE International Solid-State Circuits Conference (ISSCC) 作者：Hidehiro Fujiwara; Wei-Chang Zhao; Kinshuk Khare; Yi-Hsin Nien; Chih-Yu Lin; et al 出版日期：2025-03-07
求助人	peacat 在 2026-06-01 18:05:15 发布自江苏，悬赏 10 积分
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