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标题
13.2 A 32Gb 8.0Gb/s/pin DDR5 SDRAM with a Symmetric-Mosaic Architecture in a 5 th -Generation 10nm DRAM Process
网址
http://xplorestaging.ieee.org/ielx7/10454133/10454267/104543...
DOI
10.1109/isscc49657.2024.10454327 doi
其它 期刊：2024 IEEE International Solid-State Circuits Conference (ISSCC)
作者：Ikjoon Choi; Seunghwan Hong; Kihyun Kim; Jeong-Sik Hwang; Seunghan Woo; et al
出版日期：2024-03-13
求助人
ultrac 在 2026-08-24 17:09:51 发布自上海，悬赏 10 积分
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  • 3小时前

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  • 3小时前

    ultrac ultrac Lv3 求助人 发起了本次求助

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