A 31.5–36-GHz Low-Spur Digitally Assisted Gain-Boosting Charge-Sharing Locking PLL Achieving 54-fs RMS Jitter

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标题	A 31.5–36-GHz Low-Spur Digitally Assisted Gain-Boosting Charge-Sharing Locking PLL Achieving 54-fs RMS Jitter
网址	http://dx.doi.org/10.1109/jssc.2026.3721352
DOI	10.1109/jssc.2026.3721352 doi
其它	期刊：IEEE Journal of Solid-State Circuits 作者：Chawin Khongprasongsiri; Sayan Kumar; Patchara Sawakewang; Robert Bogdan Staszewski; Teerachot Siriburanon 出版日期：2026-01-01
求助人	滾滾在 2026-08-24 17:50:01 发布自中国台湾，悬赏 10 积分
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