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Design of joint reconfigurable hybrid adder and subtractor using FinFET and GnrFET technologies
基于FinFET和GnrFET技术的联合可重构混合加减器设计
相关领域
减法器 加法器 多路复用器 CMOS芯片 进位保存加法器 计算机科学 串行二进制加法器 电子工程 重定时 并行计算 工程类 多路复用
网址
https://doi.org/10.1016/j.vlsi.2022.09.002
DOI
10.1016/j.vlsi.2022.09.002 doi
其它 期刊：Integration
作者：D. Rebecca Florance; B. Prabhakar
出版日期：2022-09-08
求助人
punctuation 在 2025-12-09 19:58:41 发布自河南，悬赏 10 积分
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