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标题
A 0.65-V 12-16-GHz Sub-Sampling PLL With 56.4-fsrms Integrated Jitter and -256.4-dB FoM
相关领域
抖动 功勋 锁相环 CMOS芯片 电压 物理 工艺变化 电气工程 采样（信号处理） 压控振荡器 电子工程 探测器 光电子学 工程类
网址
https://doi.org/10.1109/jssc.2020.2967562
DOI
10.1109/jssc.2020.2967562 doi
其它 期刊：IEEE Journal of Solid-State Circuits
作者：Zhao Zhang; Guang Zhu; C. Patrick Yue
出版日期：2020-01-01
求助人
木木三 在 2026-01-07 11:36:36 发布自四川，悬赏 10 积分
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