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 A 6.65-to-7.75GHz Fractional-N Digital PLL with Analog Pre-Distortion DTC Implementing 2nd/3rd-Order Calibration and Achieving −65.7dBc Fractional Spur and 154fs Integrated Jitter 6.65至7.75 GHz分数N数字PLL，具有模拟预失真DTC，可实现二阶/三阶校准，实现−65.7 dBc分数杂散和154fs积分抖动
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期刊：2022 IEEE Custom Integrated Circuits Conference (CICC) 作者：Daxu Zhang; Dingxin Xu; Hòngyé Huáng; Waleed Madany; Zezheng Liu; et al 出版日期：2025-04-13 |
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